 班級人數(shù)--熱線:4008699035 手機:15921673576( 微信同號) |
| 增加互動環(huán)節(jié)，
保障培訓效果，堅持小班授課，每個班級的人數(shù)限3到5人，超過限定人數(shù),安排到下一期進行學習。 |
| 授課地點及時間 |
上課地點：【上?！浚和瑵髮W(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】：北京中山學院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈 【沈陽分部】：沈陽理工大學/六宅臻品 【鄭州分部】：鄭州大學/錦華大廈 【石家莊分部】：河北科技大學/瑞景大廈
開班時間(連續(xù)班/晚班/周末班）：2020年3月16日 |
| 課時 |
◆資深工程師授課
☆注重質(zhì)量
☆邊講邊練
☆若學員成績達到合格及以上水平，將獲得免費推薦工作的機會
★查看實驗設(shè)備詳情，請點擊此處★ |
| 質(zhì)量以及保障 |
☆
1、如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓班中重聽；
☆ 2、在課程結(jié)束之后,授課老師會留給學員手機和E-mail,免費提供半年的課程技術(shù)支持，以便保證培訓后的繼續(xù)消化；
☆3、合格的學員可享受免費推薦就業(yè)機會。
☆4、合格學員免費頒發(fā)相關(guān)工程師等資格證書，提升您的職業(yè)資質(zhì)。 |
☆課程大綱☆ |
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第一階段
Verilog for DSP
第二階段
Cordic算法實現(xiàn)
第三階段
浮點算法的定點處理
第四階段
浮點數(shù)與定點數(shù)
第五階段
浮點如何轉(zhuǎn)定點
第六階段
FPGA實現(xiàn)DSP的優(yōu)勢及應(yīng)用的典型場合
第七階段
多速率信號處理(中頻數(shù)字化的理論)
第八階段
帶通采樣定理
第九階段
內(nèi)插與抽取
第十階段
FFT IP Core的使用方法
第十一階段
FPGA+DSP架構(gòu)分析
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